Questions tagged «pullup»

上拉电阻器使线路电压升高(通常为VCC),同时允许将线路拉低。

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如何计算上拉电阻的所需值?
有很多教程将上拉或下拉电阻与开关结合使用以避免接地,例如 http://www.arduino.cc/en/Tutorial/button 这些项目中有许多使用10K电阻,只是说明它是一个很好的值。 给定一个特定的电路,我如何确定下拉电阻的适当值?可以计算出来,还是最好通过实验确定?
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I2C上拉电阻是否有正确的电阻值?
24LC256 EEPROM 的数据表指出: SDA总线需要一个上拉电阻到VCC(对于100 kHz,典型值为10kΩ;对于400 kHz和1 MHz,典型值为2kΩ)。 我以为任何电阻值为kΩ的电阻都能胜任这项工作(似乎EEPROM使用10kΩ的电阻在不同频率下都能正常工作)。 我的问题是: 上拉电阻是否有正确的值? 是否有法律/法规来确定该价值? 不同的电阻值如何影响I²C数据总线?
72 resistors  i2c  pullup 

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何时使用下拉电阻和上拉电阻
在学习和试验了微控制器之后,我了解了上拉和下拉电阻的概念。我现在了解何时以及如何使用它们,以及它们如何工作。我主要是使用上拉电路,因为我被教过,但是对我来说似乎一直有些倒退,因为关闭开关会将MCU输入设置为LOW。我认为使用下拉电阻会更有意义,以便在开关断开时输入为LOW,但这只是我的想法。 我应该向上还是向下拉单掷输入?什么时候比往上拉优先选择向下拉?

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需要使用上拉(或下拉)电阻的启发式说明
首先,我承认论坛中存在与该主题相关的几个问题,但是,这些答案假设有太多的电子学背景知识无法用于真正的初学者(例如我自己)。话虽如此,如果您选择回答,请限制您的回答仅限于启发式(非技术性)解释。 我对上拉电阻的理解是要确保线路上的电荷(而不是断开的线路)上的电荷一致,这可能会成为电场的受害者,然后产生噪声。噪声可能会被解释为输入信号,并导致设备产生意外结果。 问题1)我对上拉和下拉电阻的用途是否理解正确? 问题2)如何运作?有人可以提供一个比喻或类比来描述电流到底发生了什么吗?

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如果我省略I2C线路上的上拉电阻会怎样?
刚才我意识到I 2 C数据和时钟线(SDA和SCL)必须具有上拉电阻。 好了,根据下面的示意图,我已经使用DS1307 RTC构建了几个时钟(请参见数据表)。注意,我省略了两个上拉电阻。 两个时钟都可以正常工作,其中一个时钟已经工作了3个月以上。那怎么可能?无论如何,我想知道: 省略I 2 C上拉时会发生什么? 缺少上拉电阻是否可能损坏板上的这两个IC中的任何一个? 我得到的答案可以解决我将ATmega328P连接到DS1307 RTC的特定情况,就像我提供的原理图一样,但是如果问题不是太广泛,那么了解通常省略上拉电阻会发生什么会有所帮助。 ,即在I 2 C操作的其他情况下。 PS。我确实在网上搜索以找到答案,但是可以找到有关确定引体向上尺寸的文章。 更新:我使用的是Arduino IDE 1.03,并且我的固件使用DS1307RTC Arduino库(通过其功能RTC.read()和RTC.write())处理RTC 。该库反过来又Wire.h用来与RTC对话。 更新2:下面是一系列示波器镜头,它们帮助我解释了I 2 C 如何在没有外部上拉电阻的情况下工作。 更新3(在添加I 2 C上拉之后):以下是在I 2 C线(在同一板上)上添加适当的(4K7)上拉电阻后拍摄的另一系列示波器。上升时间从大约5 µs降至290 ns。I 2 C现在更加快乐。
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为什么I2C设计为使用上拉电阻而不使用下拉电阻?
我了解在I2C中,SCL和SDA线使用上拉电阻,并且引脚驱动器是开路集电极NPN器件,可以将引脚驱动到地。这给I2C带来了一个优势,即同一根总线现在可以与多个从机共享,即使两个或多个从机意外尝试同时驱动该总线,也不会对系统造成任何损害。 但这也可以通过在SDA和SCL线上使用PNP开漏驱动器和下拉电阻来完成。时钟延展和多主机仲裁之类的事情也可以实现。 I2C协议的当前实现是否比上述建议的替代实现有任何好处?

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输入或输出MCU引脚上的上拉和下拉电阻用法
MCU INPUT引脚仅需要上拉/下拉电阻(内部还是外部)吗?相比之下,配置为OUTPUT的MCU引脚“知道其电平”,因为它可以驱动-与另一电路的某些输入端相连的“浮动” MCU OUTPUT引脚没有意义,因为MCU引脚的状态只能是高或低...我有这个权利吗?现在,在MCU启动或发生故障时,将上拉/下拉线与此“ MCU输出至IC输入”线路相关联以确保某个IC的输入永不浮动可能是有益的。 也许我只是在这里回答了我自己的问题...根据应用的不同,上拉/下拉电阻可以在输入和输出引脚上使用吗?

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当微控制器具有内部上拉电阻时,为什么需要外部上拉电阻?
微控制器确实具有内部上拉下拉电阻,但是大多数电路都具有外部上拉电阻。 我在Google上寻找答案,有几个网站说这些电阻并不强,但我认为它们足以工作。我以为它们可能需要外部,因为内部电阻需要通过编程来触发。 因此,对于某些计划外的情况,它们还会连接外部电阻器。但是我不确定。 当我们有内部零件时,使用外部零件的真正原因是什么?


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建议使用STM32(ARM Cortex M3)上未使用的引脚的默认设置-上拉/下拉?
我们目前正在使用STM32微控制器系列的各种变体。我想知道以下内容: 如果可以选择同时选择上拉或下拉,则一般建议微控制器引脚的默认设置是什么?彼此搭配的利弊是什么?(假设您默认将它们设置为输入) 我特别想知道如何处理STM32微控制器系列中未使用的引脚。对我来说很明显,我们不应该让引脚悬空(数据表说的就是:(),但是我应该将它们设置为上拉输入还是下拉输入吗?特别是,我想选择最不易受到ESD影响的设置,如果可能的话,也要消耗最少的功率。 对于关键引脚,我们应该依靠固件将引脚正确设置为正确的默认状态,还是应该由外部硬件负责(连接外部上拉或下拉)?如果为外部电阻器选择的值大于内部上拉或下拉电阻,则固件中的设置无关紧要。 我可以看到,这样做的好处是,如果微型计算机由于某种原因(有故障的硬件等)未正确初始化,则我们将不依靠固件来正确设置引脚。 我看到的缺点是,硬件成本更高。 您能从上面得到的任何启示将不胜感激。 谢谢..

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为什么上拉电阻比下拉电阻更常见?
我注意到上拉电阻比下拉电阻更常见,为什么? 例如,Arduino的MCU具有内部上拉电路,但是这些内部上拉电路会颠倒您正在处理的事物的物理逻辑(例如,使用开关),而下拉电阻器将完成相同的工作并避免逻辑问题。
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IO引脚必须每个都有自己的上拉/下拉电阻吗?
一个非常基本的问题: 用作开关或跳线输入的微控制器的每个IO引脚是否必须具有自己的上拉/下拉电阻? 在此示例中,每个引脚均被电阻下拉,然后被1P3T开关上拉至VCC。 看起来很简单,但是随着使用更多的IO引脚,是否绝对需要更多的电阻器?有什么聪明的方法可以减少电阻的数量吗? 相关问题:共享一个上拉电阻

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当开关断开时,为什么上拉电阻器不会阻止电流流到输入引脚?
抱歉,这是一个愚蠢的问题,但我似乎无法理解。在第三张图中,它显示了一个上拉电阻。 我了解到,当开关S1闭合时,电流会下拉至地并假定值为0。这不会因为电阻限制电流而短路。 我的问题是:当开关断开并且电流流入设备的输入引脚时,如何得知这是一个高值而不是一个低值?电阻器不会将其限制到.0005 A的程度,以至于它几乎不会与器件对准吗? 编辑:另外,我只是在同一页上查看下拉电阻器的情况。当第一个开关直接连接到V CC,没有电阻,并且开关断开时,为什么它不短路?这不是禁忌吗?我真的无法把握下拉电阻的状况。

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上拉电阻澄清
我刚接触电子产品,所以很难理解“上拉电阻”的原理。我已经阅读了很多有关此的文章,我想我已经明白了,但是我不确定100%,所以我有一个问题。在本文的第一张图片之后,它说: 当按下瞬时按钮时,它将I / O引脚连接到Vcc,微控制器会将输入注册为高电平。 但是我不明白。VCC在哪里?据我所知,这种模式没有电源,只有连接到按钮的微控制器都接地,所以该电路中怎么可能有电压呢?
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上拉/下拉电阻的放置/位置?
我已经将微控制器GPIO引脚(打算用作输出)连接到DC-DC转换器的高电平有效Enable输入引脚。由于该引脚为高电平有效,并且由于我不希望该转换器在上电或需要它之前开启,因此我在该线上使用了下拉电阻以使其保持禁用状态。 对于该下拉电阻的理想放置位置,我有些困惑。应该将其放置在GPIO引脚还是GPIO引脚附近Enable? 对于上拉电阻,在Enable低电平有效且必须在线路上使用上拉电阻的情况下,也存在同样的问题。

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